本文摘要：概要首先对比分析在继续执行大规模数据移往时，传统805l单片机和展开DPTR拓展后的805l单片机在数据移往继续执行效率上的差异。通过详细分析DPTR操作者所牵涉到的因素，明确构建对DPTR的拓展，并展开实际建模测试。 单片机的经常出现是计算机技术发展史上的一个里程碑，它使计算机从海量数值计算出来转入到掌控领域。在单片机中，以8051系列尤为经典，至今仍是最普及、普遍用于的8位MUC架构。

概要首先对比分析在继续执行大规模数据移往时，传统805l单片机和展开DPTR拓展后的805l单片机在数据移往继续执行效率上的差异。通过详细分析DPTR操作者所牵涉到的因素，明确构建对DPTR的拓展，并展开实际建模测试。

　　单片机的经常出现是计算机技术发展史上的一个里程碑，它使计算机从海量数值计算出来转入到掌控领域。在单片机中，以8051系列尤为经典，至今仍是最普及、普遍用于的8位MUC架构。北界许多技术人员在其基础上大大展开性能拓展，使得805l系列芯片不断完善，从而构成一个可观的体系。

在传统的8051系列单片机中，设置了一组双字节寄存器(数据指针DPTR)，用作采访外接的64KB数据存储器和I／O模块电路；但在现今的8051单片机应用于中，特别是在嵌入式系统中，往往牵涉到大规模的数据移往操作者，而传统805l的一组数据指针用于一起则变得捉襟见肘，因此若在8051设计中将数据指针设计为两组或多组，则在继续执行大规模数据移往操作者时会非常简单、很快。在这种背景下，本文首先以数据移往继续执行效率为衡量标准，分析了DPTR拓展的意义，并在Oregano公司的MCS8051核上构建了DPTR拓展。

　　1DPTR拓展意义　　为叙述8051中的DPTR拓展的意义，我们针对构建大规模数据移往，分别对DPTR拓展前后不作了对比。为使对比更为明晰清了，明确提出了数据移往继续执行效率的概念。

　　数据移往继续执行效率v定义为展开单字节数据移往所花费的机器周期数，即XXXX其中，n回应所移往数据字节数；t回应所花费的机器周期，可原作其单位为字节／机器周期。　　在未展开DPTR拓展的8051中，可通过设置地址缓冲区的方法来构建大规模的数据移往。

明确的例程如下：　　　　　　　　在此例程中，50H、5lH用作存放数据源地址s_adr(s_adrh为高字节，s_adrl为低字节)，52H、53H用作存放数据目的地址t_adr(t_adrh为高字节，t_adr1为低字节)，构建将源地址接续64字节数据移往至目的地址。在8051中，继续执行字节数据移位操作者花费(14+28n+2)个机器周期，数据移往继续执行效率为v=n/(14+28n+2)。

在本例程中，n为64，计算出来得出结论共需花费1808个机器周期，继续执行效率v大约为O．0354字节／机器周期，而且在此构建方法中须要闲置8051的4个片内存储器(RAM)单元。　　如8051中享有两组DPTR，并可通过类似指令来构建DPTR挑选。可原作SETDPTR0指令回应挑选DPTR0，SETDPTRl指令回应挑选DPTRl，#s_adr回应数据源地址，#t_adr回应数据目的地址，则程序可设计为：　　　　　　　　程序中，对于类似指令SETDPTR0和SETDPTRl，可通过设置类似功能寄存器(SFR)以回应DPTR状态，并回应SFR展开操作者，以构建DPTR挑选。

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